A low-power, area-efficient all-digital delay-locked loop for DDR3 SDRAM controller

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標題:	A low-power, area-efficient all-digital delay-locked loop for DDR3 SDRAM controller
作者:	Hong-Ming Chen Ma, S. Wang, L. Zhang, H. Pan, K. Y. Cheng, Y. H.
公開日期:	十二月-2014
卷:	57
期:	12
來源出版物:	Science China-Information Sciences
URI:	http://scholars.ntou.edu.tw/handle/123456789/6986
ISSN:	1674-733X
DOI:	10.1007/s11432-014-5226-1 ://WOS:000346238500020
顯示於：	水產養殖學系

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